System level modeling methodology of NoC design from UML-MARTE to VHDL
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Additional Info
| Field | Value |
|---|---|
| Source | ISSN: 0929-5585 |
| Author | Elhaji, Majdi, Boulet, Pierre, Zitouni, Abdelkrim, Meftali, Samy, Dekeyser, Jean-Luc, Tourki, Rached |
| Maintainer | CCSD |
| Last Updated | May 13, 2026, 11:40 (UTC) |
| Created | May 13, 2026, 11:40 (UTC) |
| Identifier | hal-00797601 |
| Language | en |
| Rights | https://about.hal.science/hal-authorisation-v1/ |
| contributor | Contributions of the Data parallelism to real time (DART) ; Laboratoire d'Informatique Fondamentale de Lille (LIFL) ; Université de Lille, Sciences et Technologies-Institut National de Recherche en Informatique et en Automatique (Inria)-Université de Lille, Sciences Humaines et Sociales-Centre National de la Recherche Scientifique (CNRS)-Université de Lille, Sciences et Technologies-Institut National de Recherche en Informatique et en Automatique (Inria)-Université de Lille, Sciences Humaines et Sociales-Centre National de la Recherche Scientifique (CNRS)-Centre Inria de l'Université de Lille ; Institut National de Recherche en Informatique et en Automatique (Inria) |
| creator | Elhaji, Majdi |
| date | 2012-12-13T00:00:00 |
| harvest_object_id | 26fcd2e9-eb40-48d1-bfc7-6334a2fbd027 |
| harvest_source_id | 3374d638-d20b-4672-ba96-a23232d55657 |
| harvest_source_title | test moissonnage SELUNE |
| metadata_modified | 2026-01-12T00:00:00 |
| relation | info:eu-repo/semantics/altIdentifier/doi/10.1007/s10617-012-9101-2 |
| set_spec | type:ART |